专业 ASIC 设计服务

01什么是 ASIC 设计？

ASIC（专用集成电路）设计是创建针对特定应用或功能优化的定制硅芯片的过程。与通用处理器或 FPGA 不同，ASIC 专为在特定任务上实现最大效率（性能、功耗和大批量成本）而构建。

为什么选择 ASIC？

ASIC 相对于 FPGA 和软件方案具有显著优势：能效提高 10-100 倍，性能提升 2-10 倍，大批量时单位成本更低，体积更小，通过专用硅片增强安全性，并在硬件中保护专有算法。

ASIC 与 FPGA

FPGA 灵活且上市速度快，但功耗更高且单位成本更高。ASIC 需要前期 NRE（一次性工程费用）投资，但能提供卓越的 PPA（功耗、性能、面积）和更低的大规模成本。对于超过 10,000-100,000 件的批量，ASIC 通常在总成本上更具优势。

全定制与标准单元 ASIC

标准单元 ASIC 设计使用代工厂库中预先表征的逻辑单元，可实现更快的开发。全定制设计手动创建每个晶体管版图以实现终极优化。大多数现代 ASIC 设计服务采用标准单元流程，并在需要时添加定制模拟模块。

02我们的 ASIC 设计服务

全面的 ASIC 设计服务，覆盖完整的芯片开发生命周期。从架构规格到可量产的 GDSII。

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  数字 ASIC 设计

  RTL 设计与验证、综合优化、DFT 插入、时序收敛和物理实现。在复杂 SoC、处理器、加速器和高速接口（高达 112G SerDes）方面拥有丰富经验。

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  混合信号 ASIC 设计

  在同一芯片上集成模拟和数字电路。ADC、DAC、PLL、高速 I/O、电源管理和传感器接口。对物联网、汽车、医疗和通信应用至关重要。

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  模拟 IC 设计

  精密模拟电路，包括放大器、基准源、稳压器、数据转换器和射频前端。适用于测量、仪器仪表和无线系统等高要求应用的低噪声、高线性度设计。

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  物理设计与版图

  布局布线、时钟树综合、电源网格设计、IR drop 分析和 GDSII 签收。完整的物理验证，包括 DRC、LVS、天线检查和代工厂特定要求。

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  验证服务

  使用 UVM/SystemVerilog 的综合验证方法。功能仿真、形式验证、覆盖率分析、FPGA 原型验证和硅片验证支持。

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  IP 集成

  集成第三方 IP（CPU 内核、存储器、接口）和内部 IP 模块。IP 资质认证、集成验证和系统级验证，适用于复杂 SoC 设计。

03ASIC 设计流程

我们的 ASIC 芯片设计遵循行业标准方法论，确保可预测的进度和首次流片成功。

1. 01
   规格与架构

   定义功能需求、性能目标和系统架构。创建详细规格，包括接口、协议、功耗预算和测试策略。
2. 02
   RTL 设计与验证

   用 Verilog/SystemVerilog 实现设计。使用 UVM 测试平台开发全面的验证环境。在综合前达到功能覆盖率目标。
3. 03
   综合与 DFT

   将 RTL 综合为门级网表。插入扫描链、BIST 和其他 DFT 结构。针对面积、时序和功耗进行优化。生成 SDC 约束。
4. 04
   物理实现

   版图规划、布局、时钟树综合和布线。电源网格设计与 IR drop 分析。所有 PVT 角和模式的时序收敛。
5. 05
   签收与流片

   完成物理验证（DRC、LVS、ERC）。静态时序分析签收。功耗分析。生成最终 GDSII 并提交制造。
6. 06
   硅片验证

   首片硅片调试和特性表征。首次硅片问题调试支持。量产测试程序开发和良率优化。

04混合信号 ASIC 设计专长

混合信号 ASIC 设计将模拟和数字电路集成在单一芯片上，需要在两个领域的专业知识以及它们之间关键接口的处理能力。

数据转换器设计

高分辨率 SAR、sigma-delta 和流水线 ADC。电流舵、R-2R 和过采样 DAC。从 8 位到 24 位分辨率，直流到 GHz 采样率。

时钟与定时电路

整数 N 和分数 N PLL、DLL、CDR 电路和时钟分配网络。针对高速 SerDes 和精密测量应用的抖动性能优化。

电源管理

集成稳压器（LDO、开关式）、电池充电器、电源时序和能量收集电路。适用于复杂 SoC 应用的多电压轨电源管理。

传感器接口

温度、压力、加速度、磁场和光学传感器的模拟前端。低噪声放大、信号调理和数字化，用于精密测量。

05业界标准 EDA 工具

我们的 ASIC 设计服务采用领先的电子设计自动化工具，确保经过硅片验证的成果。

06ASIC 设计服务常见问题

关于定制 IC 设计和 ASIC 开发服务的常见问题。

什么是 ASIC 设计？

ASIC（专用集成电路）设计是创建针对特定应用优化的定制集成电路的过程。与通用芯片不同，ASIC 被设计为以最大效率执行特定功能。设计过程包括架构定义、RTL 编码、验证、综合、物理实现和流片制造。

ASIC 设计需要多长时间？

ASIC 设计周期因复杂度而异：简单数字 ASIC（50K-500K 门）：6-12 个月。中等复杂度 SoC（1M-10M 门）：12-18 个月。复杂的混合信号或高性能设计：18-24+ 个月。这些周期包括规格定义、设计、验证和流片。制造和封装另需 3-4 个月。

ASIC 设计费用是多少？

ASIC 设计服务费用根据复杂度从 50 万美元到 1000 万美元以上不等。关键因素：设计复杂度（门数、模拟内容）、工艺节点（先进节点需要更多工作量）、验证要求和 IP 许可费。NRE（一次性工程费用）是主要成本。在大批量生产时，单位成本可以非常低（成熟节点 1-10 美元）。

什么是混合信号 ASIC 设计？

混合信号 ASIC 设计涉及在同一芯片上创建包含模拟和数字电路的芯片。这包括数据转换器（ADC/DAC）、PLL、稳压器和传感器接口，以及数字逻辑。混合信号设计需要两个领域的专业知识，并需要仔细管理模拟-数字接口以防止噪声耦合并确保信号完整性。

何时应该选择 ASIC 而不是 FPGA？

选择 ASIC 当：(1) 产量超过 10,000-100,000 件，(2) 功耗至关重要，(3) 需要最大性能，(4) 需要最小体积，(5) 算法保护/安全性很重要，(6) 必须在规模化时最小化单位成本。选择 FPGA 当：上市时间关键，产量低，或预期设计会变化。

ASIC 设计有哪些可用的工艺节点？

ASIC 设计服务涵盖从 350nm 传统工艺到尖端 5nm/3nm 的节点。常见选择：180nm-65nm 用于模拟/混合信号（成本较低，模拟性能好），55nm-28nm 用于主流数字（性价比最佳），16nm-7nm 用于高性能（移动处理器、AI 加速器）。节点选择取决于性能需求、功耗预算和成本目标。

你们提供交钥匙 ASIC 设计服务吗？

是的，我们提供从规格到量产的全流程交钥匙 ASIC 设计服务。包括：需求分析、架构定义、RTL/模拟设计、验证、物理实现、流片、代工厂协调、封装、测试和量产支持。客户无需内部 IC 设计专业知识即可获得可工作的芯片。

你们使用什么验证方法？

我们遵循使用 UVM（通用验证方法学）和 SystemVerilog 的行业标准验证方法。包括：约束随机验证、功能覆盖率指标、关键模块的形式验证、门级仿真、静态时序分析和功耗分析。我们的目标是在流片前达到 >95% 的功能覆盖率。

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与我们的 ASIC 设计专家团队讨论您的定制 IC 需求。我们将帮助您定义最优架构和开发计划。

1. [1]
   TSMC Design Technology Platform

   Taiwan Semiconductor Manufacturing Company
2. [2]
   GlobalFoundries Design Solutions

   GlobalFoundries
3. [3]
   Synopsys ASIC Design Flow

   Synopsys Inc.
4. [4]
   Cadence Digital Implementation

   Cadence Design Systems